以深入淺出的方式教學，在課程結束的同時，學員們即能完全的掌握FPGA/CPLD的設計技巧。
課程目標：
本課程主要是以業界主流FPGA/CPLD為核心，教導學員從基礎學習，最終達到在FPGA/CPLD中建構屬於自己系統平台為教學目的。
學員可以在課程中瞭解目前業界主流 FPGA/CPLD的特色，學習如何利用FPGA/CPLD 開發屬於自己的設計。
課程內容將搭配上業界常用週邊介面如：IIC, IIS, …等，並加上FPGA Vender 提供之主要IP，如： RAM Controller …等。
上課日期：2012/12/1(六)~2012/12/29(六)
上課時間：AM9：30~PM17：30
課程時數：35小時
■艾鍗的課程有什麼不一樣
"Hands on training"的訓練方式！
因此艾鍗學院所聘請的講師皆為實際從事產品開發計設的資深RD工程師/FAE/研發經理，正因為如此，每一門課程都是提供業界實際的開發方法，不是只有提供"原理"、"架構"、"淺談",、"試講"、"觀念"這類的內容，不再讓工程師上完課，好像知道很多東西可是卻又不知道如何開始做！
艾鍗的課程是將實際產品開發過程所遇到的問題，累積解決問題的經驗，而再整理成課程來做分享！
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