ARM推新資料連接器 準備迎接新處理器架構

2015.10.28 07:43AM
27
是ARM推新資料連接器 準備迎接新處理器架構這篇文章的首圖
首圖

繼先前將CoreLink CCI-500連結器應用在Cortex-A72核心架構設計,ARM稍早宣布推出全新CoreLink CCI-550連結器,並且加入多核心多叢集配置功能,預期下一波處理器核心架構可能同樣導入多叢集 (Cluster)運作模式,亦即將如同聯發科Helio系列處理器所主推「多檔」運作模式。

螢幕快照 2015-10-28 上午7.41.04_resize

根據ARM公布消息,新版CoreLink CCI-550連結器加入主動偵測核心運作資料改變時,並且強化資料存取緩衝頻寬,將可在處理核心運作資料改變時,強化運算資料同步連結效率。此外,CoreLink CCI-550連結器將增加至連結六組處理器核心設計,架構上也能連結源自Mali GPU運算資料,藉此實現GPGPU平行運算效果,預期下一代「Mimir」Mali GPU便會支援此項設計。

而因應加入最多可連結六組處理器核心,CoreLink CCI-550連結器也加入支援最多六組記憶體通道 (對應32-48位元定址)、六組ACE主控連接埠等設計,同時提供最大頻寬可提昇60%、資料運算延遲表現降低20%,此外也能進一步降低處理器運算耗電量,並且透過平行運算方式增加整體效能,對於手機、數位電視等較耗電能產品均可達成省電目的。

此外,ARM在CoreLink CCI-550連結器端也導入DMC-500動態記憶體控制器,將支援LPDDR3-2133與最高LPDDR4-4267記憶體規格,並且提昇27%記憶體頻寬,同時降低25%處理器資料運算延遲率,本身也導入ARM TrustZone技術與DFI 4.0 PHY介面工業規範。

目前CoreLink CCI-550連結器、DMC-500動態記憶體控制器均預計在2016年下半年間問世,預期ARM也準備公布全新處理器核心架構設計。

※相關連結》

0 則回應